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MD653D不是個迅速路12十位數模轉變器（DAC），集為48:12（12通暢4:1）輸入多路多路復用技術器。片上DAC能以獨角獸高達4.5gsps的取樣系統率運行。DAC的模擬訓練讀取可在合適堅持格局（app到一、奈奎斯特中k線）或回零格局（app到一、、最后和第三方奈奎斯特中k線）之間首選。差考分頁數據庫顯示輸入模塊與LVPECL、LVDS和CML兼容。在48對差考分據輸入被多路多路復用技術到4倍的的速度后，18個迅速路數據庫顯示位被鎖存并標識號以驅使DAC讀取級。互補原理讀取可與50Ω讀取后殼設備。保證乖以4的鬧鐘讀取和取樣系統相位首選（SEL1和SEL2），以簡略而言于輸入數據庫顯示的取樣系統相位的兩端對齊。還保證了乖以8的鬧鐘讀取。而言應該一起個MD653D讀取的系統app程序流程，保證了初始化功效。

大部分作用?DAC每臺插入位的4:1復用技術率?12位分別率DAC更是高達4.5 Gsps濃度?DAC模似輸入格局可在日常要保持（NH）模試或清零（RZ）模試范圍內選定 ?帶50Ω后殼終低端專一性工作輸出?為參數同步操作提供數據互補性的除了4和除了8數字時鐘傳輸?2.8 W功能消耗?可變性400~800 mVPP單端的輸出擺幅?任何差分搜索數據報告和回零對之中的存儲芯片上100歐姆電子設備?LQFP包，帶穿孔墊